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软件无线电设计中ASIC、FPGA和DSP的选择策略
dsp或fpga的设计开发周期则要复杂得多，因为软件开发需要的资源通常比相应的硬件开发多得多。现有的经优化通用算法程序库有利于加速dsp和fpga的软件开发，但这些算法必须集成在一起实现期望的数字无线功能，因此需要完整的软件开发周期。设计人员还必须注意dsp和fpga软件开发方法之间的主要差异。在dsp上编译算法的时间通常以秒计算，而在fpga上综合处理并对类似算法进行布线的时间则需要数小时。例如xilinx公司的典型fpga布线速率为每小时400,000个门电路，因此带有2百万个门电路的xcv2000e的编译可能需要半天的时间才能完成。这使得fpga的设计调试成为一项昂贵的过程，因此fpga的设计周期通常需要在对器件算法进行布线之前，进行更多的先期分析，包括多路仿真和模型测试。性能在软件无线电结构中，任何信号处理器件的鉴定必须包括衡量该器件是否能在指定的时间内完成所需的功能。这类评估中一种最基本的基准点测量就是1,024点快速傅立叶变换(fft)处理时间的测量，参见表2中的突显部分。在表2的示例中，可编程asic明显胜过dsp或fpga实现。通常asic可为任何指定的功

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