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基于FPGA的FIR滤波器的实现
基于rom的查找表内。 2.2.6 后处理单元后处理单元的主要功能是对数据进行四舍五入和从数据流中取出需要的数据。完成四舍五入功能需要一个16位的加法器，取数据则需要16位并行d触发器。 2.2.7 控制单元控制单元主要由计数器和d触发器组成。它对电路的控制主要包括：在电路开始工作前进行全局复位，作好工作准备；对输入单元的工作进行控制；提供中间处理单元正常工作所必须的一些信号；提供最终输出结果时的输出同步信号（outsyn）。 2.3 电路原理及功能仿真采用xilinx公司的xc4005epc84设计的16阶fir低通数字滤波器的硬件电路最上层的电路原理图如图３所示。图３是fir数字滤波器的上层图，其输入输出管脚情况和硬件资源占用情况分别见表２和表３。为了检测设计的电路能否连续正确地工作，连续输入了16位数据（十进制），分别为：100,101,102,103,104,105,106,107,-101,-102,-103,-104,-105,-106,-107。fir数字滤波器硬件仿真结果（前16个输出）如表４所示。在表４中同时列出了根据文献[4]编写的程序所得到的软件计算结果。

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