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围电路设计基于简单、可靠的原则。该模块由fifo、usb2.0单片机、光电隔离器等部分组成。36路数字信号经光电隔离器进入fpga主控单元，以供采集；fpga处理采集到的信号，转换成数据进行编帧，然后写入fifo.usb单片机提取fifo中的数据，通过usb电缆传送给上位机，上位机将传送来的数据解帧，然后显示所有信号状态。模块通过电源接口向各个部分供电。其原理框图如图1所示。 3 模块电路设计 3.1 fpga配置电路 fpga是采用xilinx公司的spantan-ii系列xc2s100e，该系列器件的内核采用2.5 v供电，工作频率高达200 mhz；i／o端口供电电压为3.3 v，可承受5 v的输入高电平。spartan-ii系列的fpga具有丰富的i／o端口资源。其i／o端口输出缓冲器接收高达24 ma源出电流和48 ma灌入电流。 由于fpga基于ram工艺技术，掉电后不能保存信息，因此需要一个外置存储器来保存信息。采用一次可编程的prom(高有效或低有效)xcf01sv020，其复位引脚的极性可编程设置，供电电压为3.3 v。xcf01svo20的done、init
高达538 mb/s。此方案比较适合超高速雷达信号的实时采集与实时存盘，采用raid磁盘阵列后流盘速度得到了较大的提高，明显改善了数据传输与数据存盘之间速度不匹配这一瓶颈问题。2 硬件设计 系统硬件总体设计考虑到系统的通用性、可扩展性以及数据传输、终端处理的需要，选用通过64位/66mhz的pic局部总线与主机（服务器）进行实时数据交换，有利于实现系统的模块化设计和集成，提高了数据的灵活处理能力。pci插卡实际硬件结构如图2所示。 fpga采用xilinx(赛灵思)公司的10万门fpga芯片xc2s100e，其配置芯片的xilinx公司的1mbits容量prom芯片xc18v01,以主动串行方式对fpga进行上电配置。ad、da分别为adi（模拟仪器）公司12位高速模数转换芯片ad9224与14位高速数模转换芯片ad9764。sram采用cypress semiconductor（塞普拉斯半导体）公司的256k×16bits sram芯片cy7c1041。 设计中利用fpga实现64位/mhz的pci接口逻辑，进行实时信号采集和传输控制。由于fpga具有层次化的存储器系统，其基本逻辑功能埠可以配
时存盘，采用raid磁盘阵列后流盘速度得到了较大的提高，明显改善了数据传输与数据存盘之间速度不匹配这一瓶颈问题。2 硬件设计 系统硬件总体设计考虑到系统的通用性、可扩展性以及数据传输、终端处理的需要，选用通过64位/66mhz的pic局部总线与主机（服务器）进行实时数据交换，有利于实现系统的模块化设计和集成，提高了数据的灵活处理能力。pci插卡实际硬件结构如图2所示。 530)this.width=530" border=0> fpga采用xilinx(赛灵思)公司的10万门fpga芯片xc2s100e，其配置芯片的xilinx公司的1mbits容量prom芯片xc18v01,以主动串行方式对fpga进行上电配置。ad、da分别为adi（模拟仪器）公司12位高速模数转换芯片ad9224与14位高速数模转换芯片ad9764。sram采用cypress semiconductor（塞普拉斯半导体）公司的256k×16bits sram芯片cy7c1041。 设计中利用fpga实现64位/mhz的pci接口逻辑，进行实时信号采集和传输控制。由于fpga具有层次化的存储器系统，其基本逻辑功能埠可以配
pga作为大规模芯片的资源优势和高速运算能力，除了能产生专用dds芯片所具备的单频连续波、非连续波、各种形式的线性调频信号以外，还可以借助fpga庞大的资源优势和内部存储器，使非线性调频等更复杂的信号更容易实现。2.1 系统构成 在具体实现过程中主要采用一块基于fpga的雷达信号处理卡，既可以采集来自雷达接收机的中频、视频信号并对其进行数字信号处理，又可以自身模拟产生雷达中频、视频信号进行数字信号处理或不处理直接送往雷达信号处理机。 fpga采用xilinx公司的10万门fpga芯片xc2s100e，其配置芯片为xilinx公司的1mbit容量prom芯片xc18v01，以主动串行方式对fpga进行上电配置，a/d、d/a转换器分别为adi公司12位高速a/d数转换芯片ad9224与14位高速d/a转换芯片ad9764。sram采用cypress公司的256k×16bits sram芯片cy7c1041。 设计中利用fpga实现32位/33mhz的pci接口逻辑，进行实时信号采集和传输控制，由于fpga具有层次化的存储器系统，其基本逻辑功能块可以配置成16×1、16×2或32×1的同
费时间。为了解决这个问题，本文设计了一个读数系统，该系统通过增加每次上传的记录器的数量来提高读数系统的资源利用率，以5套记录器同时上传来计算，56分钟内可以上传5gb的数据，平均每套的上传时问仅为12分钟，提高了数据上传效率。系统框图见图1。 其中usb接口控制器选用cypress公司的cy7c68013a，该芯片是cypress公司推出的新一代高速ez—usb fx2系列芯片；单片机部分选用c8051f060芯片；主控fpga选用xilinx公司spartan—iie系列芯片xc2s100e一pq208。 fpga作为主控制中心，主要负责接收68013发送的状态指令，并将状态下发到各单片机及相应的外部设备，五个单片机分别负责通过串口接收外部设备的串行数据，并将其并行写入fpga，68013除了从fpga中读取数据外，还需要将计算机下发的控制命令发送到fpga。 1 fpga内部fif0设计 由于本项目所用fpga芯片内部ram共有40kbit，所以可构成1kb×5的fif0结构，即可构成5个深度分别为1kb的fifo，分别作为5个单片机上传时的数据缓冲，具体逻辑框
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